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VERY LOW POWER 1.8V
Features
8K/4K x 16 DUAL-PORT
STATIC RAM
IDT70P257/247L
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True Dual-Ported memory cells which allow simultaneous
reads of the same memory location
High-speed access
– Industrial: 55ns (max.)
Low-power operation
IDT70P257/247L
Active: 27mW (typ.)
Standby: 3.6 μ W (typ.)
Separate upper-byte and lower-byte control for multiplexed
bus compatibility
IDT70P257/247 easily expands data bus width to 32 bits or
more using the Master/Slave select when cascading more
than one device
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M/ S = V DD for BUSY output flag on Master
M/ S = V SS for BUSY input on Slave
Input Read Register
Output Drive Register
BUSY and Interrupt Flag
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
LVTTL-compatible, single 1.8V (±100mV) power supply
Available in 100 Ball 0.5mm-pitch BGA
Industrial temperature range (-40°C to +85°C)
Green parts available, see ordering information
Functional Block Diagram
R/ W L
UB L
LB L
CE L
OE L
R/ W R
UB R
LB R
CE R
OE R
I/O 8L -I/O 15L
I/O
I/O
I/O 8R -I/O 15R
,
BUSY L
BUSY R
I/O 0L -I/O 7L
(2,3)
Control
Control
I/O 0R -I/O 7R
(2,3)
A 12L (1)
A 0L
Address
Decoder
CE L
OE L
R/ W L
IRR 0 ,IRR 1
MEMORY
ARRAY
INPUT
READ REGISTER
AND
OUTPUT
DRIVE REGISTER
Address
Decoder
CE R
OE R
R/ W R
ODR 0 - ODR 4
A 12R (1)
A 0R
SFEN
13
13
SEM L
CE L
OE L
R/ W L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
CE R
OE R
R/ W R
SEM R
NOTES:
INT L
(3)
M/ S
INT R (3)
5684 drw 01
1. A 12X is a NC for IDT70P247.
2. (MASTER): BUSY is output; (SLAVE): BUSY is input.
3. BUSY outputs and INT outputs are non-tri-stated push-pull.
?2009 Integrated Device Technology, Inc.
1
JANUARY 2009
DSC-5684/4
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